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--- dtlab_t5 [2024/04/08 11:29] – [HEX3 und HEX2 für Summand sa] beckmanf
+++ dtlab_t5 [2025/04/10 16:24] (current) – svg to dokuwiki beckmanf
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 ==== VHDL toplevel top_hex ====
-In der Datei [[https://gitlab.elektrotechnik.hs-augsburg.de/beckmanf/dtlab/-/blob/master/src/top_hex.vhd|top_hex.vhd]] ist die höchste Hierarchie (toplevel) auf dem FPGA mit den Eingängen SW und den Ausgängen LEDR, HEX0, HEX1, HEX2, HEX3 dargestellt.
+In der Datei [[https://caeis.etech.fh-augsburg.de/beckmanf/dtlab.git/tree/src/top_hex.vhd|top_hex.vhd]] ist die höchste Hierarchie (toplevel) auf dem FPGA mit den Eingängen SW und den Ausgängen LEDR, HEX0, HEX1, HEX2, HEX3 dargestellt.
-<html>
+{{ :public:praktikum_digitaltechnik:top_hex.svg?width=300 | top_hex toplevel}}
-<img src="http://breakout.hs-augsburg.de/dwimg/top_hex.svg" width="400" >
-</html>
 Abb. 1: Toplevel top_hex
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 ==== Instantiierung von bin2seg ====
-In top_hex ist die Schaltung "bin2seg" aus der Datei [[https://gitlab.elektrotechnik.hs-augsburg.de/beckmanf/dtlab/-/blob/master/src/bin2seg.vhd|bin2hex.vhd]] zweimal instantiiert.
+In top_hex ist die Schaltung "bin2seg" aus der Datei [[https://caeis.etech.fh-augsburg.de/beckmanf/dtlab.git/tree/src/bin2seg.vhd|bin2hex.vhd]] zweimal instantiiert.
-<html>
+{{ :public:praktikum_digitaltechnik:bin2seg.svg?width=300 | bin2seg}}
-<img src="http://breakout.hs-augsburg.de/dwimg/bin2seg.svg" width="400" >
-</html>
 Abb. 3: bin2seg erzeugt die Ansteuerung einer 7-Segmentanzeige als Hexadezimalzahl